• 接下来结合CRC-4/GICREN的硬件模型分析CRC的物理现象。假设即将输入CRC-4/GICREN的比特数据为X、当前CRC的运算结果为ABCD以及X ^ A = E(此处的"^"为异或符号),注意:A、B、C、D、E及X均为二进制数,通过上述的硬件模型可得新的CRC运算结果。为便于表达,采用表格形式体现整个运算及变换的过程,如表1-1: 用文字表达上述等效模型为: 1.
  • 接下来结合CRC-4/GICREN的硬件模型分析CRC的物理现象。假设即将输入CRC-4/GICREN的比特数据为X、当前CRC的运算结果为ABCD以及X ^ A = E(此处的"^"为异或符号),注意:A、B、C、D、E及X均为二进制数,通过上述的硬件模型可得新的CRC运算结果。为便于表达,采用表格形式体现整个运算及变换的过程,如表1-1: 用文字表达上述等效模型为: 1. >>
  • 来源:www.51hei.com/bbs/dpj-93053-1.html
  • 一种基于移位寄存器的CAM的Verilog HDL实现 摘要:一种利用Verilog HDL设计CAM的方案,该方案以移位寄存器为核心,所实现的CAN具有可重新配置改变字长、易于扩展、匹配查找速度等特点,并在网络协处理器仿真中得到了应用。 关键词:CAM 移位寄存器 Verilog HDL CAM (Content Addressable Memory,内容可寻址存储器)是一种特殊的存储阵列。它通过将输入数据与CAM中存储的所有数据项同时进行比较,迅速判断出输入数据是否与CAM中的 存储数据项相匹配,并给
  • 一种基于移位寄存器的CAM的Verilog HDL实现 摘要:一种利用Verilog HDL设计CAM的方案,该方案以移位寄存器为核心,所实现的CAN具有可重新配置改变字长、易于扩展、匹配查找速度等特点,并在网络协处理器仿真中得到了应用。 关键词:CAM 移位寄存器 Verilog HDL CAM (Content Addressable Memory,内容可寻址存储器)是一种特殊的存储阵列。它通过将输入数据与CAM中存储的所有数据项同时进行比较,迅速判断出输入数据是否与CAM中的 存储数据项相匹配,并给 >>
  • 来源:1-fun.com/a/ruanjiankaifa/2016/0814/1195.html
  • 4.4.2 移位型计数器 移位寄存器也可以构成计数器,称为移位型计数器。它有两种结构:环形计数器和扭环形计数器。 图 4-4-3 环形计数器和扭环形计数器 4.4.3 串-并变换器及并-串变换器 串-并变换器是把若干位串行二进制编码变成并行二进制编码的电路。并-串变换器则刚刚相反。  图 4-4-4 8位串-并变换器  图 4-4-5 8位并-串变换器 4.
  • 4.4.2 移位型计数器 移位寄存器也可以构成计数器,称为移位型计数器。它有两种结构:环形计数器和扭环形计数器。 图 4-4-3 环形计数器和扭环形计数器 4.4.3 串-并变换器及并-串变换器 串-并变换器是把若干位串行二进制编码变成并行二进制编码的电路。并-串变换器则刚刚相反。 图 4-4-4 8位串-并变换器 图 4-4-5 8位并-串变换器 4. >>
  • 来源:gc.nuaa.edu.cn/digital/kejian/ch4/4-4.htm
  • 这是单价,数量100片起价格另议 概述: 74HC595 是一款漏极开路输出的CMOS 移位寄存器,输出端口为可控的三态输出 端,亦能串行输出控制下一级级联芯片。 特点: 􀁺 高速移位时钟频率Fmax>25MHz 􀁺 标准串行(SPI)接口 􀁺 CMOS 串行输出,可用于多个设备的级联 􀁺 低功耗:TA =25时,Icc=4A(MAX)
  • 这是单价,数量100片起价格另议 概述: 74HC595 是一款漏极开路输出的CMOS 移位寄存器,输出端口为可控的三态输出 端,亦能串行输出控制下一级级联芯片。 特点: 􀁺 高速移位时钟频率Fmax>25MHz 􀁺 标准串行(SPI)接口 􀁺 CMOS 串行输出,可用于多个设备的级联 􀁺 低功耗:TA =25时,Icc=4A(MAX) >>
  • 来源:880927.21523.30la.com.cn/list.asp?id=55
  • 11.3 伪随机序列 在扩频系统中,信号频谱的扩展是通过扩频码实现的。扩频系统的性能与扩频码的性能有很大关系,对扩频码通常提出下列要求:易于产生;具有随机性;扩频码应该具有尽可能长的周期,使干扰者难以从扩频码的一小段中重建整个码序列;扩频码应该具有双值自相关函数和良好的互相关特性,以利于接收时的捕获和跟踪,以及多用户检测。 从理论上说,用纯随机序列去扩展频谱是最理想的,例如高斯白噪声,但在接收机中为了解扩应当有一个同发送端扩频码同步的副本,因此实际上只能用伪随机或伪噪声序列作为扩频码。伪随机序列具有貌似噪
  • 11.3 伪随机序列 在扩频系统中,信号频谱的扩展是通过扩频码实现的。扩频系统的性能与扩频码的性能有很大关系,对扩频码通常提出下列要求:易于产生;具有随机性;扩频码应该具有尽可能长的周期,使干扰者难以从扩频码的一小段中重建整个码序列;扩频码应该具有双值自相关函数和良好的互相关特性,以利于接收时的捕获和跟踪,以及多用户检测。 从理论上说,用纯随机序列去扩展频谱是最理想的,例如高斯白噪声,但在接收机中为了解扩应当有一个同发送端扩频码同步的副本,因此实际上只能用伪随机或伪噪声序列作为扩频码。伪随机序列具有貌似噪 >>
  • 来源:book.51cto.com/art/200907/138387.htm
  • 首次循环时开始时,根据LABVIEW数据流的控制方式,从左侧寄存器单元读取SR寄存器的当前值。由于所有SR单元初始化为0,所以首次读取的SR单元值均为0。当循环结束时,输入数组的首个元素2进入SR的数据输入端,同时进行移位操作。以后每次循环依次类推。表格1详细说明了每次循环前后SR单元中存储值的变化情况。
  • 首次循环时开始时,根据LABVIEW数据流的控制方式,从左侧寄存器单元读取SR寄存器的当前值。由于所有SR单元初始化为0,所以首次读取的SR单元值均为0。当循环结束时,输入数组的首个元素2进入SR的数据输入端,同时进行移位操作。以后每次循环依次类推。表格1详细说明了每次循环前后SR单元中存储值的变化情况。 >>
  • 来源:blog.csdn.net/lz2906190/article/details/38870277?locationNum=9
  • 步进电机内部结构如图1所示:  如何能使它转起来呢?一搬有两种方法: 1.单相驱动:一相一相驱动,线圈加高电平顺序是:黄蓝红橙;或是:橙红蓝黄。其中黑白接地。 2.双相驱动:当要求电动机输出大功率时可以两相两相同时驱动,线圈加高电平顺序为:黄+红蓝+橙;或是:橙+蓝红+黄。 了解步进电机的驱动方式后、我想到了用移位寄存器产生移位脉冲来让步进电机动起来。电路如图2。  图2是通过拨码开关控制74LS194使Q0、Q1、Q2、Q3产生上面提过的两种移位脉冲来控制U1(光电耦合器
  • 步进电机内部结构如图1所示: 如何能使它转起来呢?一搬有两种方法: 1.单相驱动:一相一相驱动,线圈加高电平顺序是:黄蓝红橙;或是:橙红蓝黄。其中黑白接地。 2.双相驱动:当要求电动机输出大功率时可以两相两相同时驱动,线圈加高电平顺序为:黄+红蓝+橙;或是:橙+蓝红+黄。 了解步进电机的驱动方式后、我想到了用移位寄存器产生移位脉冲来让步进电机动起来。电路如图2。 图2是通过拨码开关控制74LS194使Q0、Q1、Q2、Q3产生上面提过的两种移位脉冲来控制U1(光电耦合器 >>
  • 来源:www.zxskj.cn/dianzi/zidongkongzhidianlu/1316.html
  •   当工作于并行输入/串行输出时(串行输入端D为0),首先清零,使四个触发器的输出全为0。再给寄存指令之前,G3-G0四个与非门的输出全为1。当加上该指令时,并设并行输入的二进制数d3d2d1d0=1011,于是G3,G1,G0输出置1负脉冲,使触发器F3,F1,F0的输出为1,G2和F2的输出未变。这样,就把1011输入寄存器。而后输入移位脉冲C,使d0,d1,d2 ,d3依次(从低位到高位)从 Q
  •   当工作于并行输入/串行输出时(串行输入端D为0),首先清零,使四个触发器的输出全为0。再给寄存指令之前,G3-G0四个与非门的输出全为1。当加上该指令时,并设并行输入的二进制数d3d2d1d0=1011,于是G3,G1,G0输出置1负脉冲,使触发器F3,F1,F0的输出为1,G2和F2的输出未变。这样,就把1011输入寄存器。而后输入移位脉冲C,使d0,d1,d2 ,d3依次(从低位到高位)从 Q >>
  • 来源:www.musen.com.cn/news/15655.html
  •   寄存器是用来暂时存放数码的,是由 构成的。一个触发器只能存储1位二进制数,要存放 九位二进制数时,就需用瓦个触发器。按照功能的不同,寄存器可分为数码寄存器和移位寄存器。数码寄 存器具有寄存数码的功能,雨移位寄存器不仅有寄存数码的功能,还有移位的功能。移位寄存器中的数据 可以在移位脉冲作用下依次逐位右移或左移,数据既可以并行输入、并行输出,也可以串行输入、串行输 出,还可以并行输人、串行输出,串行输人、并行输出,输人输出方式十分灵活,用途也很广。根据移位 情况不同,移位寄存器分为单向移位寄存器(左移寄存
  •   寄存器是用来暂时存放数码的,是由 构成的。一个触发器只能存储1位二进制数,要存放 九位二进制数时,就需用瓦个触发器。按照功能的不同,寄存器可分为数码寄存器和移位寄存器。数码寄 存器具有寄存数码的功能,雨移位寄存器不仅有寄存数码的功能,还有移位的功能。移位寄存器中的数据 可以在移位脉冲作用下依次逐位右移或左移,数据既可以并行输入、并行输出,也可以串行输入、串行输 出,还可以并行输人、串行输出,串行输人、并行输出,输人输出方式十分灵活,用途也很广。根据移位 情况不同,移位寄存器分为单向移位寄存器(左移寄存 >>
  • 来源:www.gdjyw.com/web-shebei/dianqidianlujichu/15784.html
  • 需要的功能模块都集成到一个 里, 构建一个可编程的片上系统[1]。它还具有灵活的设计方式,可裁减、可扩充、可升级,具备系统可编程等功能,是一种优秀的嵌入式系统设计技术[2]。本文研究了一种基于SOPC技术的嵌入式数字音频录放系统的设计方案。系统通过在FPGA芯片上配置NiosII软核处理器和相关的接口模块来实现嵌入式系统的主要硬件结构,并结合嵌入式系统所支持的软件设计来控制音频编/解码芯片WM8731和SDRAM,实现了音频信号的A/D、D/A转换、存储、回放等功能。由于采用了SOPC和DMA控制技术,该
  • 需要的功能模块都集成到一个 里, 构建一个可编程的片上系统[1]。它还具有灵活的设计方式,可裁减、可扩充、可升级,具备系统可编程等功能,是一种优秀的嵌入式系统设计技术[2]。本文研究了一种基于SOPC技术的嵌入式数字音频录放系统的设计方案。系统通过在FPGA芯片上配置NiosII软核处理器和相关的接口模块来实现嵌入式系统的主要硬件结构,并结合嵌入式系统所支持的软件设计来控制音频编/解码芯片WM8731和SDRAM,实现了音频信号的A/D、D/A转换、存储、回放等功能。由于采用了SOPC和DMA控制技术,该 >>
  • 来源:www.lightingsd.com/html/zhaomingbaike/dianzijishu/2009/0322/45479.html
  • 前段时间做了个迷你电子称跟大家分享一下。 当时设计的时候想着用两节五号干电池让它工作,综合了一下成本,选用了STC15W408AS 20P 做主控,采用74HC595串口驱动数码管做显示。 不得不在这里赞扬一下STC15W408AS这个单片机,个人认为它价格便宜,功能强大,引脚少,更重要的是工作电压是5.
  • 前段时间做了个迷你电子称跟大家分享一下。 当时设计的时候想着用两节五号干电池让它工作,综合了一下成本,选用了STC15W408AS 20P 做主控,采用74HC595串口驱动数码管做显示。 不得不在这里赞扬一下STC15W408AS这个单片机,个人认为它价格便宜,功能强大,引脚少,更重要的是工作电压是5. >>
  • 来源:www.ndiy.cn/forum.php?mod=viewthread&tid=33868&highlight=STC15W
  • 移位寄存器 移位寄存器不仅有存放数码而且有 的功能。 下图是由JK触发器组成的四位移位寄存器  下图是由维持阻塞型D触发器组成的四位移位寄存器。它既可并行输入(输入端为,)/串行输出(输出端为),又可串行输入(输入端为D)/串行输出。    下图所示的是应用于加法器中的一种。图中,,,是三个n位的移位寄存器,和是并行输入/串行输出,是串行输入/并行输出。  
  • 移位寄存器 移位寄存器不仅有存放数码而且有 的功能。 下图是由JK触发器组成的四位移位寄存器 下图是由维持阻塞型D触发器组成的四位移位寄存器。它既可并行输入(输入端为,)/串行输出(输出端为),又可串行输入(输入端为D)/串行输出。   下图所示的是应用于加法器中的一种。图中,,,是三个n位的移位寄存器,和是并行输入/串行输出,是串行输入/并行输出。   >>
  • 来源:eelab.sjtu.edu.cn/dg/wlkc/netpages/d22_2_2.htm
  • 为了说明设计方案,以一个宽度为4位、深度为1的基本CAM存储单元为例。利用这样一个基本存储单元,通过适当级联,可以构成任意字宽和深度的CAM。该基本单元采用一个16位的移位寄存器、一个4位的比较器,外加16位的计数器和一个"二选一"的选择器构成。如图2所示。 500)this.style.
  • 为了说明设计方案,以一个宽度为4位、深度为1的基本CAM存储单元为例。利用这样一个基本存储单元,通过适当级联,可以构成任意字宽和深度的CAM。该基本单元采用一个16位的移位寄存器、一个4位的比较器,外加16位的计数器和一个"二选一"的选择器构成。如图2所示。 500)this.style. >>
  • 来源:lunwen.freekaoyan.com/ligonglunwen/dianzi/20080218/120329669280790.shtml
  • 旧服务已下线,请迁移至 http://api.fanyi.baidu.com,日本购购 Japangogo,日本购购凭借专业的代购经验,为广大朋友提供高效,优质,专业的日本商品代购,雅虎商品代购,乐天商品代购。日本购购帮助客户采购纯正的日本商品,安心的购物环境,不需要客户懂日语也能轻松购日货。 日本购购,日本雅虎代购,日本乐天代购,日本代购,日本安心代购,日本化妆品代购,日本电子代购,日本专业代购,日本团购 日本购购 Japangogo:
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  • 来源:japangogo.com/ya.php?ac=V&id=joshin_4974019647715-42-911
  • 从上面的算法可以看出,处理数据的采样时钟对每一个抽头来说都是并行的,并且加法器和移位寄存器采用级联方式,完成了累加器的功能,综合了加法器和移位寄存器的优点,而且这种算法的各级结构相同,方便扩展,实现了任意阶数的滤波器。算法中,真正点用系统资源的是乘法器。如果将系数量化成二进制,就能采用移位寄存器和加法器实现乘法功能。对于一个特定的滤波器,由于它有固定的系数,乘法功能就是一个长数乘法器。下面将讨论乘法器的设计问题。 2 FIR并行滤波器的乘法器设计 在并行滤波器的设计中,每一个乘法器的一端输入数据,另一端为
  • 从上面的算法可以看出,处理数据的采样时钟对每一个抽头来说都是并行的,并且加法器和移位寄存器采用级联方式,完成了累加器的功能,综合了加法器和移位寄存器的优点,而且这种算法的各级结构相同,方便扩展,实现了任意阶数的滤波器。算法中,真正点用系统资源的是乘法器。如果将系数量化成二进制,就能采用移位寄存器和加法器实现乘法功能。对于一个特定的滤波器,由于它有固定的系数,乘法功能就是一个长数乘法器。下面将讨论乘法器的设计问题。 2 FIR并行滤波器的乘法器设计 在并行滤波器的设计中,每一个乘法器的一端输入数据,另一端为 >>
  • 来源:xilinx.eetop.cn/?action-viewnews-itemid-144
  • PS4主机虽然已被破解,装上Linux系统,还能玩Steam游戏,但都还是初步的,黑客们也都在努力钻研更多好玩的可能性。 最近有一队德国黑客就陷入了苦恼,无法使PS4 GPU获得任何输出显示,也无法处理任何画面,于是他们就在网上到处翻资料。 首先,Linux Radeon显卡驱动源代码被发现没啥帮助,不完整,也不能获得完整画面。 不过互联网之大无奇不有,他们在一个不起眼的网站上发现了AMD Bonarie GPU(HD 7790/R7 260)的寄存器参考,这可是玩转GPU的圣经。 虽然PS4里边使用的A
  • PS4主机虽然已被破解,装上Linux系统,还能玩Steam游戏,但都还是初步的,黑客们也都在努力钻研更多好玩的可能性。 最近有一队德国黑客就陷入了苦恼,无法使PS4 GPU获得任何输出显示,也无法处理任何画面,于是他们就在网上到处翻资料。 首先,Linux Radeon显卡驱动源代码被发现没啥帮助,不完整,也不能获得完整画面。 不过互联网之大无奇不有,他们在一个不起眼的网站上发现了AMD Bonarie GPU(HD 7790/R7 260)的寄存器参考,这可是玩转GPU的圣经。 虽然PS4里边使用的A >>
  • 来源:news.mydrivers.com/1/514/514544.htm
  • 0  引言 L ED 图文显示屏没有公认的严格定义,其主要特征是只控制L ED 点阵中各发光器件的通断(发光 或熄灭) ,而不控制L ED 的发光强弱。L ED 器件的颜色可以是单色、双色,甚至是多色的。L ED 图文屏的外观可以做成条形,叫做条形图文显示屏(简称条屏) ,也可以按照一定的高宽比例做成矩形的平面图文显示屏。实际上,条屏不过是宽度远大于高度的图文显示屏,在显示与控制原理上并无区别,故本文以条屏为例加以说明。 1  显示系统简介 图文显示系统由多块显示屏和上位计算机组成。每块显示屏的位置是分散
  • 0  引言 L ED 图文显示屏没有公认的严格定义,其主要特征是只控制L ED 点阵中各发光器件的通断(发光 或熄灭) ,而不控制L ED 的发光强弱。L ED 器件的颜色可以是单色、双色,甚至是多色的。L ED 图文屏的外观可以做成条形,叫做条形图文显示屏(简称条屏) ,也可以按照一定的高宽比例做成矩形的平面图文显示屏。实际上,条屏不过是宽度远大于高度的图文显示屏,在显示与控制原理上并无区别,故本文以条屏为例加以说明。 1  显示系统简介 图文显示系统由多块显示屏和上位计算机组成。每块显示屏的位置是分散 >>
  • 来源:www.embed.cc/HTML/MCU/zongheyingyong/2018/0701/15455.html