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在数字频率计中,测周期计数器是主要的电路,其功能是:使用标准

     数字频率计的VHDL实现      上述的同步测周期数字频率计在Altera公司的FPGA开发平台QuartusII中实现,模块采用VHDL语言描述,具有通用性和可重用性。图1中的同步测周期计数器的VHDL描述如下:      libraryieee;      useieee.std_logic_1164.all;      useieee.
 
     数字频率计的VHDL实现      上述的同步测周期数字频率计在Altera公司的FPGA开发平台QuartusII中实现,模块采用VHDL语言描述,具有通用性和可重用性。图1中的同步测周期计数器的VHDL描述如下:      libraryieee;      useieee.std_logic_1164.all;      useieee. | 宽350x407高 | 显示比例:100% | 查看原图 | 图片来源:www.ybzhan.cn
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