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要用寄存器和触发器设计电路

4 FPGA设计中避免毛刺的其他注意事项 4.1 电路选用 要用寄存器和触发器设计电路,尽量不要用锁存器,因它对输入信号的毛刺太敏感。如果坚持用锁存器设计必须保证输入信号绝对没有毛刺,且满足保持时间。 4.2 译码器 设计设计译码逻辑电路时必须十分小心,因为译码器和比较器本身会产生尖峰,容易产生毛刺,把译码器或比较器的输出直接连到时钟输入端或异步清除端,会造成严重的后果。 4.
 
4 FPGA设计中避免毛刺的其他注意事项 4.1 电路选用 要用寄存器和触发器设计电路,尽量不要用锁存器,因它对输入信号的毛刺太敏感。如果坚持用锁存器设计必须保证输入信号绝对没有毛刺,且满足保持时间。 4.2 译码器 设计设计译码逻辑电路时必须十分小心,因为译码器和比较器本身会产生尖峰,容易产生毛刺,把译码器或比较器的输出直接连到时钟输入端或异步清除端,会造成严重的后果。 4. | 宽497x218高 | 显示比例:100% | 查看原图 | 图片来源:xilinx.eetrend.com
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